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Remove f14 to f31 from FREG and FSREG.

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This would have happened later, if f14 to f31 became regvar (like r13
to r31 are now).  I am doing it now because ncg is too slow for rules
"with FREG FREG uses FREG".  We use such rules for adf 8 and other EM
instructions that operate on 2 floats.  Like my last commit cfbc537,
this commit speeds ncg by removing choices for register allocation.
This commit is contained in:
George Koehler 2016-10-18 21:16:47 -04:00
parent cfbc537959
commit 99dee0ad24
1 changed files with 23 additions and 37 deletions
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60
mach/powerpc/ncg/table
View file

@ -104,24 +104,29 @@ REGISTERS
PAIR_R5_R6=R5+R6 : REG_PAIR. PAIR_R5_R6=R5+R6 : REG_PAIR.
PAIR_R3_R4=R3+R4 : REG_PAIR. PAIR_R3_R4=R3+R4 : REG_PAIR.
F31("f31") : FPR, FREG, FPR31. /*
F30("f30") : FPR, FREG, FPR30. * F14 to F31 are reserved for regvar, if we ever implement
F29("f29") : FPR, FREG, FPR29. * it. Don't add them to FREG; the register allocator would
F28("f28") : FPR, FREG, FPR28. * be too slow.
F27("f27") : FPR, FREG, FPR27. */
F26("f26") : FPR, FREG, FPR26. F31("f31") : FPR, FPR31.
F25("f25") : FPR, FREG, FPR25. F30("f30") : FPR, FPR30.
F24("f24") : FPR, FREG, FPR24. F29("f29") : FPR, FPR29.
F23("f23") : FPR, FREG, FPR23. F28("f28") : FPR, FPR28.
F22("f22") : FPR, FREG, FPR22. F27("f27") : FPR, FPR27.
F21("f21") : FPR, FREG, FPR21. F26("f26") : FPR, FPR26.
F20("f20") : FPR, FREG, FPR20. F25("f25") : FPR, FPR25.
F19("f19") : FPR, FREG, FPR19. F24("f24") : FPR, FPR24.
F18("f18") : FPR, FREG, FPR18. F23("f23") : FPR, FPR23.
F17("f17") : FPR, FREG, FPR17. F22("f22") : FPR, FPR22.
F16("f16") : FPR, FREG, FPR16. F21("f21") : FPR, FPR21.
F15("f15") : FPR, FREG, FPR15. F20("f20") : FPR, FPR20.
F14("f14") : FPR, FREG, FPR14. F19("f19") : FPR, FPR19.
F18("f18") : FPR, FPR18.
F17("f17") : FPR, FPR17.
F16("f16") : FPR, FPR16.
F15("f15") : FPR, FPR15.
F14("f14") : FPR, FPR14.
F13("f13") : FPR, FREG, FPR13. F13("f13") : FPR, FREG, FPR13.
F12("f12") : FPR, FREG, FPR12. F12("f12") : FPR, FREG, FPR12.
F11("f11") : FPR, FREG, FPR11. F11("f11") : FPR, FREG, FPR11.
@ -137,24 +142,6 @@ REGISTERS
F1("f1") : FPR, FREG, FPR1. F1("f1") : FPR, FREG, FPR1.
F0("f0") : FPR, FPR0. F0("f0") : FPR, FPR0.
FS31("f31")=F31 : FSREG.
FS30("f30")=F30 : FSREG.
FS29("f29")=F29 : FSREG.
FS28("f28")=F28 : FSREG.
FS27("f27")=F27 : FSREG.
FS26("f26")=F26 : FSREG.
FS25("f25")=F25 : FSREG.
FS24("f24")=F24 : FSREG.
FS23("f23")=F23 : FSREG.
FS22("f22")=F22 : FSREG.
FS21("f21")=F21 : FSREG.
FS20("f20")=F20 : FSREG.
FS19("f19")=F19 : FSREG.
FS18("f18")=F18 : FSREG.
FS17("f17")=F17 : FSREG.
FS16("f16")=F16 : FSREG.
FS15("f15")=F15 : FSREG.
FS14("f14")=F14 : FSREG.
FS13("f13")=F13 : FSREG. FS13("f13")=F13 : FSREG.
FS12("f12")=F12 : FSREG. FS12("f12")=F12 : FSREG.
FS11("f11")=F11 : FSREG. FS11("f11")=F11 : FSREG.
@ -168,7 +155,6 @@ REGISTERS
FS3("f3")=F3 : FSREG. FS3("f3")=F3 : FSREG.
FS2("f2")=F2 : FSREG. FS2("f2")=F2 : FSREG.
FS1("f1")=F1 : FSREG. FS1("f1")=F1 : FSREG.
/* FS0("f0")=F0 */
LR("lr") : SPR. LR("lr") : SPR.
CTR("ctr") : SPR. CTR("ctr") : SPR.